Circuits

    [Accept 후기] ISSCC 2022 / 한국 실적 / KAIST / 삼성 / Press Conference
    Circuits/Paper

    [Accept 후기] ISSCC 2022 / 한국 실적 / KAIST / 삼성 / Press Conference

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    [Journal] SCI/SCIE 급 논문 확인
    Circuits/Paper

    [Journal] SCI/SCIE 급 논문 확인

    관련 글 리스트 [Accept 후기] JSSC / IEEE Journal of Solid-State Circuits SCI와 SCIE는 2020년에 통합되었다. 따라서 SCIE 급인지 아닌지만 따지면 된다. Web of Science Master Journal List Try our new Master Journal List site, by the Web of Science Group, a Clarivate company. mjl.clarivate.com 위 링크로 들어간 후 ISSN 혹은 논문 title로 검색해보면 된다. 예를 들어, Solid-State Circuits로 검색해보면 아래와 같이 나온다. 위와 같이, Science Citation Index Expanded (SCIE) 라고 표시되어 ..

    [Accept 후기] ISSCC 2022 / 미국 입국 / 코로나 백신
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    [Accept 후기] ISSCC 2022 / 미국 입국 / 코로나 백신

    Entering USA from Switzerland 0. 관련 글 리스트 [Accept 후기] ISSCC 2022 / IEEE International Solid-State Circuit Conference [Accept 후기] ISSCC 2022 / 한국 실적 / KAIST / 삼성 / Press Conference [Accept 후기] ISSCC 2022 / Hybrid Format / COVID-19 [Accept 후기] ISSCC 2022 / Conference Registration [Accept 후기] ISSCC 2022 / Fully Virtual (비대면)로 전환 [Attend 후기] ISSCC 2022 / Regular Presentation / SRP ISSCC organizer 측에..

    [Accept 후기] ISSCC 2022 / IEEE International Solid-State Circuit Conference
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    [Accept 후기] ISSCC 2022 / IEEE International Solid-State Circuit Conference

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    [Measurement] SMU로 μW급~nW급 Chip의 True-RMS Current 측정하기
    Circuits/PCB

    [Measurement] SMU로 μW급~nW급 Chip의 True-RMS Current 측정하기

    Overview Source Measurement Unit (SMU)는 상당히 낮은 값의 current 혹은 voltage 까지 측정이 가능한 장비이다. (fA, nV 급의 장비도 쉽게 볼 수 있다) 이름에서부터 알 수 있듯, Source를 한 다음 Measurement를 하는 원리이며 Chip 측정하는 사람들 입장에서는 voltage를 source하고 이 때 current는 얼마나 소모되는지를 확인하여 해당 chip의 power consumption을 파악할 수 있다. 그런데 문제가 있는데, SMU는 주로 transistor 혹은 LED 등과 같이 단일 소자의 V-I curve 등을 파악하는데 특화되어 있다는 점이다. 즉, DC measurement에 특화된 친구인데, 아래 그림과 같이 power co..

    [PCB] IC 정리 - OpAmp
    Circuits/PCB

    [PCB] IC 정리 - OpAmp

    관련 글 리스트 [PCB] IC 정리 - LDO Regulator 성능이 좋은 OpAmp를 발견할 때마다 여기에 적어놓을 예정이다. TLV910x TLV9101 data sheet, product information and support | TI.com Channels Current Input Z (CM/DM) Input Current DC Gain GBW Input Range 1~4 0.12mA/Ch 6TΩ || 1pF 100MΩ || 3pF ±10pA >125dB 1.1MHz 200mV Beyond Rail Supply Noise CMRR PSRR Output (Static) Output (Dynamic) ±1.35V~±8V 28nV/√Hz @ 1kHz >85dB @ 60Hz >60dB @ 60Hz..

    [Accept 후기] JSSC / IEEE Journal of Solid-State Circuits (2nd)
    Circuits/Paper

    [Accept 후기] JSSC / IEEE Journal of Solid-State Circuits (2nd)

    0. 관련 글 리스트 [Accept 후기] JSSC / IEEE Journal of Solid-State Circuits (3rd) 드디어 나의 2번째 JSSC 논문의 accept 메일을 받았다 ! 첫번째 JSSC 논문보다는 모든 과정이 훨씬 빠르게 진행되어서 매우 만족스럽다. 1. Revisions 1번의 Major Revision, 1번의 Minor Revision을 거쳐 Accept까지 총 4개월 2주 정도가 걸렸다. Invited paper가 아니라 Regular로 제출한 paper임을 감안하면 확실히 빨리 진행된 편이다. (본 논문은 VLSI Symposium 2020의 extension으로 작성되었다.) Major/Minor Revision을 받았을 때는 1달의 기간이 주어졌다. 이 때, 시간..

    [Logic Gates] D-Flip-Flop (D-FF)
    Circuits/Digital

    [Logic Gates] D-Flip-Flop (D-FF)

    1. Positive Edge-Triggered D-FF 초창기에 탄생한 D-FF이다. 여러 개의 NAND-3 gate로 nSR latch를 만들어 FF을 구성한다. (2개의 NAND gate를 cross-coupling 하면 nSR latch가 된다) 왼쪽에는 2개의 nSR latch가 input stage로, 오른쪽에는 1개의 nSR latch가 output stage로 존재하며 CLK이 low일 때 input stage의 output은 모두 high 이므로 output latch는 input signal에 관계 없이 preserve 상태가 된다. 요새는 대부분의 standard cell에서 얘보다는 아래에서 설명할 TGFF를 훨씬 더 많이 사용한다. 2. Transmission-Gate D-FF (..

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